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b541d42218
@ -716,8 +716,12 @@ SYS_PAGE EQU #FE
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.Sp_RAMD_KEYS.T EQU #C1FF
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.Sp_RAMD_KEYS.NUM EQU .RAMD_KEYS.NUM
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;
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.RAMD_FAT EQU #C200 ; RAM Table
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.RAMD_FAT EQU #C200 ; ALIGN 256 ; RAM Table
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.RAMD_FAT.Size EQU 256
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.MS_BPB EQU #C400 ; ¡ãä¥à BPB
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; IDENTIFY ATA buffer
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.HD_IDF_ADR EQU #C600 ; !FIXIT áâàãªâãன ᤥ« âì!!!
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.HD_IDF_ADR.sec_cyl EQU .HD_IDF_ADR+4
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@ -725,7 +729,6 @@ SYS_PAGE EQU #FE
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.HD_IDF_ADR.sectors EQU .HD_IDF_ADR+12 ; Number of sectors per track
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.HD_IDF_ADR.LBA_CHS EQU .HD_IDF_ADR+99 ; LBA/CHS
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.HD_IDF_ADR.ModelNum EQU .HD_IDF_ADR+54
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;
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.MS_DIR EQU #C800 ; ¡ãä¥à DIR sector
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@ -749,7 +752,9 @@ SYS_PAGE EQU #FE
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.TASK_2_DATA ZX_TASK_DATA = #EC30
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.TASK_3_DATA ZX_TASK_DATA = #EC40
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;!TODO EQU #EC50 - #EFFF
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.SHARED_BUFFER_256b EQU #EC50 - #EFFF ; 256 ¡ ©â
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;!TODO EQU #ED50 - #EFFF
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.RESTART_ID EQU #F000 ; db "RESTART",0 ;First start identificator
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@ -1141,7 +1146,7 @@ Chip_ID:
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.K50 EQU #3C7B
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;
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; ¢ãâ२¥ ¯®àâë Altera (ç áâ¨ç® ¥à §®¡à ® ®â Sp97)
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||||
;00 <EFBFBD>¥â ¯®àâ
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||||
;#00 <09>¥â ¯®àâ
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;#01 reserved
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;#02 reserved
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||||
;#03 reserved
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@ -1659,23 +1664,23 @@ INIT_TBL_IDE3 HDD_INIT_TABLE = SYS_PAGE.IDE_3 ; !HARDC
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Write:
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.Data EQU #0150 ; cnf 20 ; HDW_DAT W170 ; #1F0 Data register
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.Features EQU #0151 ; cnf 21 ; HDW_ERR W171 ; #1F1 Features register
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||||
.Counter EQU #0152 ; cnf 22 ; HDW_CNT P_S_CNT W172 ; #1F2 Counter register
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||||
.Sector EQU #0153 ; cnf 23 ; HDW_SEC P_S_NUM W173 ; #1F3 Sector register
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||||
.CylinderLow EQU #0154 ; cnf 24 ; HDW_CLL P_C_LOW W174 ; #1F4 Cylinder Low register
|
||||
.CylinderHigh EQU #0155 ; cnf 25 ; HDW_CLH P_C_HIG W175 ; #1F5 Cylinder High register
|
||||
.Counter EQU #0152 ; cnf 22 ; HDW_CNT P_S_CNT W172; #1F2 Counter register
|
||||
.Sector EQU #0153 ; cnf 23 ; HDW_SEC P_S_NUM W173; #1F3 Sector register
|
||||
.CylinderLow EQU #0154 ; cnf 24 ; HDW_CLL P_C_LOW W174; #1F4 Cylinder Low register
|
||||
.CylinderHigh EQU #0155 ; cnf 25 ; HDW_CLH P_C_HIG W175; #1F5 Cylinder High register
|
||||
.DeviceHead EQU #4152 ; cnf 26 ; HDW_DRV P_HD_CS ; #1F6 Device/Head register
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||||
.Command EQU #4153 ; cnf 27 ; HDW_COM P_CMD ; #1F7 Command register
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||||
.DeviceControl EQU #4154 ; cnf 28 ; ; #3F6 Device Control register
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Read:
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.Data EQU #0050 ; cnf 20 ; HDR_DAT P_DATS R170 ; #1F0 Data register
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.Error EQU #0051 ; cnf 21 ; HDR_ERR P_ERR R171 ; #1F1 Error register
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||||
.Counter EQU #0052 ; cnf 22 ; HDR_CNT R172 ; #1F2 Counter register
|
||||
.Sector EQU #0053 ; cnf 23 ; HDR_SEC R173 ; #1F3 Sector register
|
||||
.CylinderLow EQU #0054 ; cnf 24 ; HDR_CLL R174 ; #1F4 Cylinder Low register
|
||||
.CylinderHigh EQU #0055 ; cnf 25 ; HDR_CLH R175 ; #1F5 Cylinder High register
|
||||
.Control EQU #4052 ; cnf 26 ; HDR_DRV R176 ; #1F6 Device/Head register
|
||||
.Status EQU #4053 ; cnf 27 ; HDR_CTL P_HDST R177 ; #1F7 Status (Control) register
|
||||
.Data EQU #0050 ; cnf 20 ; HDR_DAT P_DATS R170; #1F0 Data register
|
||||
.Error EQU #0051 ; cnf 21 ; HDR_ERR P_ERR R171; #1F1 Error register
|
||||
.Counter EQU #0052 ; cnf 22 ; HDR_CNT R172; #1F2 Counter register
|
||||
.Sector EQU #0053 ; cnf 23 ; HDR_SEC R173; #1F3 Sector register
|
||||
.CylinderLow EQU #0054 ; cnf 24 ; HDR_CLL R174; #1F4 Cylinder Low register
|
||||
.CylinderHigh EQU #0055 ; cnf 25 ; HDR_CLH R175; #1F5 Cylinder High register
|
||||
.Control EQU #4052 ; cnf 26 ; HDR_DRV R176; #1F6 Device/Head register
|
||||
.Status EQU #4053 ; cnf 27 ; HDR_CTL P_HDST R177; #1F7 Status (Control) register
|
||||
.AltStatus EQU #4054 ; cnf 28 ; ; #3F6 Alternate Status register
|
||||
.DrvAddress EQU #4055 ; cnf 29 ; ; #3F7
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@ -1692,7 +1697,7 @@ ControlBit: ; 0000 0000 ; Bits for IDE.Read.Status
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||||
.SeekComplete EQU 4;ÄÄÄÄÄÄÄÄÄÄÄÙ ³³³³ ; Service for ATAPI
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.DataRequest EQU 3;ÄÄÄÄÄÄÄÄÄÄÄÄÄÙ³³³ ; DRQ
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||||
.CorrectedData EQU 2;ÄÄÄÄÄÄÄÄÄÄÄÄÄÄÙ³³ obsolete
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||||
.Index EQU 1;ÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÙ³ obsolete .SenseDataAvailable
|
||||
.Index EQU 1;ÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÙ³ obsolete ; .SenseDataAvailable
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||||
.Error EQU 0;ÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÙ ; Indicates an error occurred. Send a new command to clear it (or nuke it with a Software Reset).
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||||
.CheckCondition EQU .Error
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||||
.StreamError EQU .Fault
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||||
@ -2296,11 +2301,11 @@ REG:
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;HDW_CLH EQU #0155 ; #1F5 Cylinder High
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;P_C_HIG EQU #0155
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||||
;HDW_CLL EQU #0154 ; #1F4 Cylinder Low
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;P_C_LOW EQU #154
|
||||
;P_C_LOW EQU #0154
|
||||
;HDW_SEC EQU #0153 ; #1F3 Sector
|
||||
;P_S_NUM EQU #0153
|
||||
;HDW_CNT EQU #0152 ; #1F2 Counter
|
||||
;P_S_CNT EQU #152
|
||||
;P_S_CNT EQU #0152
|
||||
;HDW_ERR EQU #0151 ; #1F1 Error
|
||||
;HDW_DAT EQU #0150 ; #1F0 Data
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||||
;HDR_CTL EQU #4053 ; #1F7 Status (Control)
|
||||
@ -2311,9 +2316,9 @@ REG:
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||||
;HDR_SEC EQU #0053 ; #1F3 Sector
|
||||
;HDR_CNT EQU #0052 ; #1F2 Counter
|
||||
;HDR_ERR EQU #0051 ; #1F1 Error
|
||||
;P_ERR EQU #051 ; READ
|
||||
;P_ERR EQU #0051 ; READ
|
||||
;HDR_DAT EQU #0050 ; #1F0 Data
|
||||
;P_DATS EQU #50 ; READ/WRITE INIR/OTIR
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;P_DATS EQU #0050 ; READ/WRITE INIR/OTIR
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;;Bits for HDR_CTL
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;;---[]
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